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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1994년도 가을 학술발표논문집 제21권 제2호(A)
발행연도
1994.10
수록면
481 - 484 (4page)

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본 논문은 논리 설계 단계에서의 논리 회로와 레이아웃 설계로부터 추출된 논리 회로를 직접 비교함으로써 레이아웃 설계 단계에서의 회로 연결 상태를 검증하는 검증 도구에 관하여 기술한다. 레이아웃으로부터 추출된 평면화 된 회로로부터 원래의 논리 설계의 계층 구조를 계층적 패턴 인식 기법과 동적인 국소 refinement에 의해 bottom-up 형태로 복원해 가는 과정에서 전체 회로에 대한 검증을 수행함으로써 기존의 검증 방식으로는 해결하기 어려웠던 회로 비교를 이용한 검증 상의 문제점들이 쉽게 해결되고 설계자의 오류를 보다 정확히 찾아내는 것이 가능해졌다.

목차

요약

Ⅰ. 서론

Ⅱ. 논리 비교에 의한 검증

Ⅲ. 계층적 패턴 인식기의 구현

Ⅳ. 결론

참고문헌

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